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EE版 - 借问大家设计layout时都留最少多少trace spacing
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g******u
发帖数: 3060
1
我一般都用最小8mil.但是最近公司收回一个客户的板子,上面12mil的connector输
出还被污染了,据说是什么metal migration.
有没有人知道类似标准?我知道IPC好像是4还是5mil.但是涉及到类似上述问题时,
我查不到有关标准。
t*****i
发帖数: 56
2
一般尽量大点吧。呵呵
j***j
发帖数: 324
3
除非限制很死,我一般留越打越好(尽量10mil以上)。
那个啥metal migration 恶心死了,表面根本看不出来,里面有的都short了。不过那
个跟留间隙无关吧,再大也能给弄花了,应该让他们重做。

【在 g******u 的大作中提到】
: 我一般都用最小8mil.但是最近公司收回一个客户的板子,上面12mil的connector输
: 出还被污染了,据说是什么metal migration.
: 有没有人知道类似标准?我知道IPC好像是4还是5mil.但是涉及到类似上述问题时,
: 我查不到有关标准。

f*****0
发帖数: 489
4
if I use to92 inline, I typically do 10mil minimum and 15mil preferred;
otherwise, I do 15mil minimum.
g******u
发帖数: 3060
5
老兄此话可真?有什么出处。
事实上我老板还让我研究一下有没防止metal migration的spacing规定。

【在 j***j 的大作中提到】
: 除非限制很死,我一般留越打越好(尽量10mil以上)。
: 那个啥metal migration 恶心死了,表面根本看不出来,里面有的都short了。不过那
: 个跟留间隙无关吧,再大也能给弄花了,应该让他们重做。

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